Taken from ECE253 2015 midterm question 5
Consider the sequential circuit below:
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24module top_module ( input clk, input L, input r_in, input q_in, output reg Q); wire w1; Mux2_1 ins1(q_in, r_in,L,w1); flip_flop ins2(w1,clk,Q); endmodule module flip_flop(input D, input clk, output Q); always @(posedge clk) Q <= D; endmodule module Mux2_1(input a, input b, input choose, output D); always @(*) if (choose) D = b; else D = a; endmodule
最后
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