VL2 异步复位的串联T触发器
这题就两个串联T触发器。
T触发器的原理：
0：保持
1：翻转
中间有一个过程q1
`timescale 1ns/1ns
module Tff_2 (
input wire data, clk, rst,
output reg q
);
reg q1;
always @ ( posedge clk or negedge rst ) begin
if( !rst )
q1 <= 1'b0;
else if(data)
q1 <= !q1;
else
q1 <= q1;
end
always @ ( posedge clk or negedge rst ) begin
if( !rst )
q <= 1'b0;
else if(q1)
q <= !q;
else
q <= q;
end
endmodule
最后
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