我是靠谱客的博主 彩色刺猬,最近开发中收集的这篇文章主要介绍verilog符号 与或非 异或_Verilog运算符,觉得挺不错的,现在分享给大家,希望可以做个参考。

概述

按位取反(

~

)

1

个多位操作数按位取反。例如:

a=4'b1011

,则

~a

的结果为

4'b0100

按位与(

&

)

2

个多位操作数按位进行与运算,各位的结果按顺序组成一个新的多位数。例

如:

a=2'b10

b=2'b11

,则

a&b

的结果为

2'b10

按位或(

|

)

2

个多位操作数按位进行或运算,各位的结果按顺序组成一个新的多位数。例

如:

a=2'b10

b=2'b11

,则

a|b

的结果为

2'b11,

即只要有一个为

1

,结果就是

1

按位异或

(

^

)

2

个多位操作数按位进行异或运算,

各位的结果按顺序组成一个新的多位数。

例如:

a=2'b10

b=2'b11

,则

a^b

的结果为

2'b01

按位同或(

~^

^~

)

2

个多位操作数按位进行同或运算,各位的结果按顺序组成一个新的

多位数。例如:

a=2'b10

b=2'b11

,则

a~^b

的结果为

2'b10

逻辑取反(

!

)

:对

1

个操作数进行逻辑取反,如果这个操作数为

0

,则结果为

1

;如果这个

操作数不为

0

,则结果为

0

逻辑与(

&&

)

:对

2

个操作数进行逻辑与,如果二者同为

0

或同不为

0

,则结果为

1

,否则

0

。例如:

3 && 0

的结果为

0

逻辑或(

||

)

:对

2

个操作数进行逻辑或,如果二者其中至少有一个不为

0

,则结果为

1

,否

则为

0

。例如:

3||0

的结果为

1

最后

以上就是彩色刺猬为你收集整理的verilog符号 与或非 异或_Verilog运算符的全部内容,希望文章能够帮你解决verilog符号 与或非 异或_Verilog运算符所遇到的程序开发问题。

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