我是靠谱客的博主 震动帽子,最近开发中收集的这篇文章主要介绍设计一个同步时序电路, 使得每输入4个周期的CLK脉冲, 便输出一个正脉冲, 其宽度等于CLK脉冲的周期. 要求用下降沿触发的JK触发器和尽可能少的门电路构成.,觉得挺不错的,现在分享给大家,希望可以做个参考。

概述

        根据题目的描述, 须先设计一个同步四进制(加法)计数器.

        根据四进制加法计数器的状态变化特性, 绘制状态表.

状态表
Q1Q0Q1*Q0*Z
00010
01100
10110
11001

        根据状态表, 绘制状态激励表.

状态激励表
Q1Q0Q1*Q0*J1K1J0K0Z
00010×1×0
01101××10
1011×01×0
1100×1×11

         由状态激励表, 得知 J1=K1=Q0, J0=K0=1, Z=Q1Q0.

         由上面的分析, 绘制电路的原理图.

最后

以上就是震动帽子为你收集整理的设计一个同步时序电路, 使得每输入4个周期的CLK脉冲, 便输出一个正脉冲, 其宽度等于CLK脉冲的周期. 要求用下降沿触发的JK触发器和尽可能少的门电路构成.的全部内容,希望文章能够帮你解决设计一个同步时序电路, 使得每输入4个周期的CLK脉冲, 便输出一个正脉冲, 其宽度等于CLK脉冲的周期. 要求用下降沿触发的JK触发器和尽可能少的门电路构成.所遇到的程序开发问题。

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