数电实验（三）利用3线-8线译码器74LS138和与非门设计一个表决电路
要求：
设计一个表决电路，
当控制端M=0时，输入端A、B、C一致同意时，输出F为1，否则输出为0；当控制端M=1时，输入端A、B、C多数同意时，输出F为1，否则输出为0。要求用3线—8线译码器74LS138和与非门实现。
Multisim仿真：
最后
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