概述
自己写了一个复位延时模块，直接调用就可以了，直接修改参数。本文中输入时钟50MHZ，延时50MS复位。程序如下。
module power_on_rst
#(
parameter CLK_FRE = 50,
parameter DELAY_MS = 50
)
(
input clk,
input rst_n,
output power_on_rstn
);
reg [31:0] rst_cnt ;
localparam RESET_DELAY = CLK_FRE1000DELAY_MS ; //
always @(posedge clk or negedge rst_n)
begin
if (!rst_n)
rst_cnt <= 32’d0 ;
else if (rst_cnt < RESET_DELAY) //50ms
rst_cnt <= rst_cnt + 1’b1 ;
else
rst_cnt <= rst_cnt ;
end
assign power_on_rstn = (rst_cnt < RESET_DELAY)? 1’b0 : 1’b1 ;
endmodule
本人天津某高校在读硕士研究生，研究领域FPGA的并行计算，有兴趣联系QQ55967545。
最后
以上就是舒心芹菜为你收集整理的FPGA复位的延迟模块的全部内容，希望文章能够帮你解决FPGA复位的延迟模块所遇到的程序开发问题。
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