概述
试过几种网上说的方法，就这个试通了。在verilog程序中添加相对应的代码即可。
reg [7:0] i =0;
always @ (posedge clk)
begin
if (!rst_n)
i <=0;
else if (i<255)
i <= i+1;
else
i<= 255;
end
integer w_file;
initial w_file = $fopen("data_out_1.txt");
always @(i)
begin
$fdisplay(w_file,"%d",rom_data_I);
if(i == 8'd254) //共写入254个数据
$stop;
end 需要说明，%d输出的是十进制数据， %h输出的是十六进制数据如果，rom_data_I是 wire signed[8:0]rom_data_I; 声明过的，定义为有符号数，则在txt文件中保存的就是有符号数，否则，默认为无符号数。说明: 操作发现txt 一直没有数据，检查代码也没错，最后发现，是要把modelsim/vivado 自带仿真软件关闭以后，数据才能存入到 txt 文件里
最后
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