浅谈Verilog中的逻辑运算符
缩位运算符都是单目运算符，一般是将缩位运算符放置在操作数前面，如&A、|B、^C、^~D等等，注意千万不要放到后面去，缩微运算和前面讲的逻辑类运算区别度高，我们来看一下其综合的电路有什么特殊之处。结果说明，当in1为010和001时输出的结果都是一样的，也就是说010和001其实都代表着真，只有当in1=000时代表假，所以输出变成0。如“A===1'bx”当A等于x时，整体就为1，所以===更加严格，连x和z都比较。test的功能是将in1与in2进行逻辑与，看好哦，in1与in2。.
