DDR3的配置及仿真教程
具体的DDR的内部工作情况以及一些情况，在之前的博客写过了。这系列博客主要是调用MIG（Memory Interface Solution） IP对DDR的控制使用，MIG由三部分组成User Interface Block 、Memory controller 和Physical Layer。IP的一边是连接DDR3的接口（Physical interface）。另一半是用户逻辑控制接口（User FPGA Logic）。想要正确的控制DDR3的读写，需要正确的设置MIG和正确的用户逻辑控制接
