深入浅出时序逻辑电路（1）

80 阅读 0 评论 53 点赞

我是靠谱客的博主大胆项链，最近开发中收集的这篇文章主要介绍深入浅出时序逻辑电路（1），觉得挺不错的，现在分享给大家，希望可以做个参考。

概述

我们一提到时序逻辑电路，就会想到触发器

先讲讲时序逻辑电路：时序逻辑电路（常简称为时序电路）内部包含存储器，用于记忆电路的工作状态和输入变化情况，其输出由当前的输入和存储信息共同确定的一种电路。
再讲讲几种最基本的触发器

1.RS触发器

在这里插入图片描述

$\overline{Q}$ =1称为触发器的0状态， $\overline{Q}$ =0称为触发器的触发状态（1状态）

RS=01，触发器状态为0
RS=10，触发器状态为1，若s变为1，结果也是1
RS=11，触发器状态为1
保存在RS=00，破坏了两个触发器输出信号应该相反的规则

总结：所谓稳定状态，是指当输入信号为无效电平时（这里是RS 11  ），触发器的状态稳定不变。

同步RS触发器

在这里插入图片描述

特点：当CP为高电平时，G₃G₄的输出分别为 $\overline{S}$ $\overline{R}$

在这里插入图片描述

最后

以上就是大胆项链为你收集整理的深入浅出时序逻辑电路（1）的全部内容，希望文章能够帮你解决深入浅出时序逻辑电路（1）所遇到的程序开发问题。

如果觉得靠谱客网站的内容还不错，欢迎将靠谱客网站推荐给程序员好友。

本图文内容来源于网友提供，作为学习参考使用，或来自网络收集整理，版权属于原作者所有。

本文分类：电子电路
浏览次数：80 次浏览
发布日期：2023-05-26 18:03:02
本文链接：https://www.kaopuke.com/article/k-p-k_14_ujocf5_14__7__18_z.html

深入浅出时序逻辑电路（1）

概述

我们一提到时序逻辑电路，就会想到触发器

先讲讲时序逻辑电路：时序逻辑电路（常简称为时序电路）内部包含存储器，用于记忆电路的工作状态和输入变化情况，其输出由当前的输入和存储信息共同确定的一种电路。

再讲讲几种最基本的触发器

1.RS触发器

$\overline{Q}$ =1称为触发器的0状态， $\overline{Q}$ =0称为触发器的触发状态（1状态）

RS=01，触发器状态为0

RS=10，触发器状态为1，若s变为1，结果也是1

RS=11，触发器状态为1

保存在RS=00，破坏了两个触发器输出信号应该相反的规则

总结：所谓稳定状态，是指当输入信号为无效电平时（这里是RS 11  ），触发器的状态稳定不变。

同步RS触发器

特点：当CP为高电平时，G₃G₄的输出分别为 $\overline{S}$ $\overline{R}$

最后

评论列表共有 0 条评论

发表评论取消回复

深入浅出时序逻辑电路（1）

概述

我们一提到时序逻辑电路，就会想到触发器

先讲讲时序逻辑电路：时序逻辑电路（常简称为时序电路）内部包含存储器，用于记忆电路的工作状态和输入变化情况，其输出由当前的输入和存储信息共同确定的一种电路。

再讲讲几种最基本的触发器

1.RS触发器

Q ‾ overline{Q} Q​=1称为触发器的0状态， Q ‾ overline{Q} Q​=0称为触发器的触发状态（1状态）

RS=01，触发器状态为0

RS=10，触发器状态为1，若s变为1，结果也是1

RS=11，触发器状态为1

保存在RS=00，破坏了两个触发器输出信号应该相反的规则

总结： 所谓稳定状态，是指当输入信号 为无效电平时（这里是RS 11  ），触发器的状态稳定不变。

同步RS触发器

特点：当CP为高电平时，G3G4的输出分别为 S ‾ overline{S} S R ‾ overline{R} R

最后

相关文章

评论列表共有 0 条评论

发表评论 取消回复

$\overline{Q}$ =1称为触发器的0状态， $\overline{Q}$ =0称为触发器的触发状态（1状态）

总结：所谓稳定状态，是指当输入信号为无效电平时（这里是RS 11  ），触发器的状态稳定不变。

特点：当CP为高电平时，G₃G₄的输出分别为 $\overline{S}$ $\overline{R}$

发表评论取消回复