FPGA数字IC的Verilog刷题解析基础版02——T触发器（异步复位和同步复位）
1.题目用verilog实现两个串联的异步低电平复位的T触发器的逻辑。这个题目的重点是要关注异步低电平复位。不得不读的 FPGA 设计白皮书——Xilinx FPGA 复位策略白皮书翻译（WP272）【FPGA探索者】联发科数字IC简答题（9）——异步复位同步释放问题2.解析2.1T触发器边沿T触发器：输入为1时下个时钟触发沿输出翻转；输入为0时下个时钟触发沿输出保持。边沿D触发器，输入为1时下个时钟触发沿输出为1，输入为0时下个时钟触发沿输出为0。所以关于...
