数字逻辑基础与verilog硬件描述语言_初学FPGA， 怎么从硬件上理解？
先理解组合逻辑和时序逻辑，后面就好说了，这里先讲讲狭义的组合逻辑和时序逻辑，时序逻辑一般指的是D触发器，组合逻辑指的是：与门 或门 非门，比较器，选择器，编码器，译码器，加法器，当然还有两类比较特殊的就是三态门和RAM，时序逻辑D触发器需要时钟来驱动的，也就是必须要有时钟才会 动作，而组合逻辑不需要时钟驱动，在时序图上的表现就是时序逻辑的输出比输入晚一个时钟周期，而组合逻辑输入和输出都是在同一个时...
