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2年10月17天
system verilog中module和program的区别

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首先module和program之间有很多相似之处:1.和module相同，program也可以定义0个或多个输入、输出、双向端口。2.一个program块内部可以包含0个或多个initial块、generate块、specparam语句、连续赋值语句、并发断言、timeunit声明。3.在program块中数据类型、数据声明、函数和任务的定
system verilog 2024-01-25
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笔记 2023-09-01
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Other 2023-07-17

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