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概述
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陈涛
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发表于 2011-12-14 13:45 |
只看该作者
时序约束,STA
本帖最后由 陈涛 于 2011-12-15 15:39 编辑 (1) clock (2) IO端口的约束 (3) DRV (4) false path,multicycle path (5) wire load model (6) clock gating (7) case_analysis set_case_analysis可以强制某个node为0/1 (8) ideal net/network ideal_net只作用于这条net
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3#
发表于 2011-12-14 13:45 |
只看该作者
综合DC/RC
本帖最后由 陈涛 于 2011-12-19 12:38 编辑 (1)综合的注意事项
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发表于 2011-12-14 13:46 |
只看该作者
APR (floorplan, place, CTS,route)
本帖最后由 陈涛 于 2012-9-30 08:41 编辑 (1) 文件的准备和网表的检验 (2) 一个好的floorplan (3) 时序收敛 (4) 低功耗 (5) ECO ECO分为post mask ECO 和pre mask ECO,也就是只修改metal layer的ECO和任何layer都可以动到的ECO
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最后
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